JPS6374243A - Intelligent modem - Google Patents
Intelligent modemInfo
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- JPS6374243A JPS6374243A JP61218845A JP21884586A JPS6374243A JP S6374243 A JPS6374243 A JP S6374243A JP 61218845 A JP61218845 A JP 61218845A JP 21884586 A JP21884586 A JP 21884586A JP S6374243 A JPS6374243 A JP S6374243A
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Abstract
Description
【発明の詳細な説明】 Ａ、産業上の利用分野 本発明はインテリジェントモデムに関するしのである。[Detailed description of the invention] A. Industrial application field The present invention relates to intelligent modems.
Ｂ０発明の概要
本発明はＣＰＵを内蔵するインテリジェントモデムにお
いて、
前記ＣＰＵを第１のＣＰＵと第２のＣＰ［Ｊの２つ設け
ること？こより、
モデムの機能の多様化を図ると共にモデムの小型化を図
るものである。B0 Summary of the Invention The present invention provides an intelligent modem with a built-in CPU, including two CPUs, a first CPU and a second CPU [J? This aims to diversify the functions of modems and make modems smaller.
Ｃ６従来の技術
従来、パーソナルコンピュータやその他のコンピユータ
を電話回線に接続して通信する場合には、変復調装置（
「モデム」）が一般に用いられている。C6 Prior Art Conventionally, when a personal computer or other computer is connected to a telephone line for communication, a modulation/demodulation device (
"modem") is commonly used.
かかるモデムには、内蔵のＣＰＵによって高度な処理を
実現できるものがある。Some such modems can implement advanced processing using a built-in CPU.
第３図は従来のインテリジェントモデムの一例を示すブ
ロック図である。FIG. 3 is a block diagram showing an example of a conventional intelligent modem.
この図において符号１００はインテリジェントモデムで
、インテリジェントモデム１００はインタフェース１０
１を介して端末機器１０２のコネクタ１０２ａに双方向
接続してある。インタフェース１０１はＲ３−２３２ｃ
で、このインタフェース１０１と双方向接続してあるの
は、汎用非同期式送／受信器（以下ｒＵＡＲＴＪと略称
する。）１０３である。ＵＡＲＴ１０３は４０ビンＤＩ
Ｐのパッケージ汎用ＩＣから成り、非同期データの送／
受信を全二重または半二重方式で行なう。Ｕ Ａ ＲＴ
１０３に双方向接続されているのは、バスライン１０
４で、このバスライン１０４には、この他に処理中枢を
司どるＣ Ｐ Ｕ １０５、読取り専用メモリであるＲ
ＯＭ １０６、読書きが可能なメモリであるＲ Ａ
Ｍ １０７、タイマの動作条件を任意に設定することが
可能なプログラマブルタイマ１０８、Ｕ Ａ ＲＴ １
０９、割込み制御に用いるインクラブドコントローラ１
１０及びゲート回路又はラッチ回路で形成されているＩ
／ ０１１１が双方向接続されている。ｌ１０１１１
に接続されているのは、スイッチ１１２及びＬ Ｅ Ｄ
１１３である。Ｕ Ａ ＲＴ １０９及びｌ１０１１
１と双方向接続されているのはモデムＬ Ｓ Ｉ １１
４で、このモデムＬ Ｓ Ｉ １１４は信号伝搬を高速
で行なうものである。モデムＬ Ｓ Ｉ １１４及びＩ
１０ボート１１１と双方向接続されているのは、ハイブ
リットＩＣ１１５で、ハイブリットＩＣ１１５はＩＣ、
ダイオード等のデバイスを組み合わせ１つのパッケージ
内に集積化したものである。ハイブリットＩＣｌ３と双
方向接続してあるのは、ＤＡＡ１１６であり、ＤＡＡ１
１６はデータのアクセス順序を決めるらのである。図中
、鎖線で囲んである部分がモデム制御部である。Ｄ Ａ
Ａ １１６と接続してあるのは電話器１１．７で、電
話器１１７は電話回線１１８に接続してある。またハイ
ブリットＩＣ１１５はアンプ１１９を介してスピーカ１
２０に接続してある。このスピーカ１２０はダイアルト
ーン、ビジィトーン及びリングバックトーン等を監視す
るものである。In this figure, reference numeral 100 is an intelligent modem, and the intelligent modem 100 has an interface 10.
1 to the connector 102a of the terminal device 102. Interface 101 is R3-232c
A general-purpose asynchronous transmitter/receiver (hereinafter abbreviated as rUARTJ) 103 is bidirectionally connected to this interface 101. UART103 has 40 bin DI
It consists of a packaged general-purpose IC of P, and is capable of asynchronous data transmission/
Reception is performed in full-duplex or half-duplex mode. U A RT
Bus line 10 is bidirectionally connected to 103.
4, this bus line 104 also includes a CPU 105 that controls the processing center, and a read-only memory R.
OM 106, R A is a memory that can be read and written.
M 107, programmable timer 108 that can arbitrarily set the operating conditions of the timer, U A RT 1
09, Included controller 1 used for interrupt control
10 and an I formed of a gate circuit or a latch circuit.
/0111 are bidirectionally connected. l10111
Connected to the switch 112 and L E D
It is 113. U A RT 109 and l1011
The modem LSI 11 is bidirectionally connected to 1.
4, this modem LSI 114 performs signal propagation at high speed. Modem LSI 114 and I
The hybrid IC 115 is bidirectionally connected to the 10 boat 111, and the hybrid IC 115 is an IC,
It is a combination of devices such as diodes and integrated into one package. DAA116 is bidirectionally connected to hybrid ICl3, and DAA1
16 determines the data access order. In the figure, the part surrounded by a chain line is the modem control section. D A
Connected to A 116 is telephone 11.7, and telephone 117 is connected to telephone line 118. In addition, the hybrid IC 115 connects to the speaker 1 via the amplifier 119.
It is connected to 20. This speaker 120 monitors dial tones, busy tones, ringback tones, and the like.
本インテリジェントモデムによれば、モデムにインテリ
ノエント機能をもたせることができる。According to this intelligent modem, the modem can be provided with an intelligent function.
Ｄ６発明が解決しようとする問題点
しかし、かかるインテリジェントモデムでは、機能の多
様化を図る場合にモデムが大型化してしまうという問題
がある。D6 Problems to be Solved by the Invention However, with such an intelligent modem, there is a problem in that the modem becomes larger when diversifying its functions.
本発明の目的は、モデムの多機能化を図ることができる
と共に小型化を図ることができるインテリジェントモデ
ムを提供することにある。SUMMARY OF THE INVENTION An object of the present invention is to provide an intelligent modem that can be made multi-functional and downsized.
Ｅ０問題点を解決するための手段
上記問題点を解決するための手段として本発明は、非同
期データの送信及び受信を行なう非同期式送受信装置と
処理中枢を司どるＣＰＵを第１のバスラインに接続し、
前記ＣＰＵからの制御信号によりモデム制御部を制御す
るインテリジェントモデムであって、前記ＣＰＵは前記
第１のバスラインを経て第１のＩ／Ｏに接続してある第
１のＣＰＵと、前記第１のＩ／Ｏと接続してある第２の
Ｉ／Ｏに、第２のバスラインを介して接続してある第２
のＣＰＵとからなり、前記第１のＩ／Ｏとインターラブ
ドコントローラが接続してあり、また前記第２のバスラ
インを介して第３のＩ／Ｏが接続してあることを特徴と
する。Means for Solving the E0 Problem As a means for solving the above problem, the present invention provides a method for connecting an asynchronous transmitting/receiving device that transmits and receives asynchronous data and a CPU that controls a processing center to a first bus line. death,
An intelligent modem that controls a modem control unit by a control signal from the CPU, wherein the CPU is connected to a first CPU connected to a first I/O via the first bus line, and the first I/O. A second I/O connected to the second I/O via a second bus line.
The first I/O is connected to an interwoven controller, and the third I/O is connected via the second bus line.
２０作用
本インテリジェントモデムは、２つのＣＰＵを用いるこ
とによりモデムの機能を多様化する。また本モデムでは
モデムの小型化を図り、消費電力を低くする。20 Functions This intelligent modem diversifies the functions of the modem by using two CPUs. In addition, this modem is designed to be smaller and consume less power.
Ｇ、実施例
次に、本発明インテリジェントモデムの一実施例を添附
図面に基づいて詳細に説明する。G. Embodiment Next, an embodiment of the intelligent modem of the present invention will be described in detail with reference to the accompanying drawings.
第１図は本発明インテリジェントモデムの一実施例を示
すブロック図である。FIG. 1 is a block diagram showing an embodiment of the intelligent modem of the present invention.
この図において符号１はインテリジェントモデムで、イ
ンテリジェントモデムｌはインタフェース２を介して端
末機器３のコネクタ３ａに双方向接続してある。このイ
ンタフェース２はＲ５−２３２Ｃであり、インタフェー
ス２と双方向接続してあるのが汎用非同期式送受信装置
（以下ｒＵＡＲＴｊと略称する。）４である。ＵＡＲＴ
４は４０ピンＤＩＰのパッケージＩＣからなる送信没
び受信装置で、このうち、送信装置は、並列のキャラク
タデータを与えると非同期直列信号に変換し出力するも
ので、また受信装置は非同期直列信号データを受は取る
と、これを並列のキャラクタデータに変換し出力するも
のである。前記ＵＡＲＴ４に双方向接続されているのは
、第１のバスライン５で、この第■のバスライン５には
ＣＰＵ６、ＲＯＭ７、ＲＡ Ｍ ８及びプログラマブル
９が双方向接続されている。ＣＰＵ６は処理中枢を司ど
り、ＲＯＭ７はＣＰＵ６からの制御信号により記憶する
読取り専用のメモリで、ＲＡＭ８はＣＰＵＧからの制御
信号により記憶する読書きが可能なメモリである。In this figure, reference numeral 1 denotes an intelligent modem, and the intelligent modem 1 is bidirectionally connected to a connector 3a of a terminal device 3 via an interface 2. This interface 2 is an R5-232C, and a general-purpose asynchronous transmitting/receiving device (hereinafter abbreviated as rUARTj) 4 is bidirectionally connected to the interface 2. UART
4 is a transmitting/receiving device consisting of a 40-pin DIP package IC. Of these, the transmitting device converts parallel character data into an asynchronous serial signal and outputs it, and the receiving device converts the asynchronous serial signal data into an asynchronous serial signal and outputs it. When the receiver receives the data, it converts it into parallel character data and outputs it. A first bus line 5 is bidirectionally connected to the UART 4, and a CPU 6, a ROM 7, a RAM 8, and a programmable memory 9 are bidirectionally connected to the first bus line 5. The CPU 6 controls the processing center, the ROM 7 is a read-only memory that stores data in accordance with control signals from the CPU 6, and the RAM 8 is a read/write memory that stores data in accordance with control signals from the CPUG.
またプログラマブルタイマ９はＣＰＵ６からの制御信号
と図示しないユーザの設定するいわゆるユーザオリエン
ティド信号によってタイマの動作条件を任意に設定する
ものである。更に本実施例のインテリジェントモデムに
は、第１のバスライン５にｌ１０１０、インタラブドコ
ントローラ１１及び第１の１１０１２が双方向接続して
ある。ｌ１０１０にはモデムＬＳ１１３及びハイブリッ
トＩＣ１４が双方向接続してあり、モデムＬＳ１１３と
ハイブリットＩＣ１４は双方向接続してある。ハイブリ
ットＩＣ１４と双方向接続してあるのは、データアクセ
スアライメント（Ｄ Ａ Ａ ）１５で、ＤＡＡ１５に
は電話器１６が接続してあり、電話器１６には電話回線
１７か接続してある。また、ハイブリットＩＣ１４には
アンプ１８を経てスピーカ１９が接続してある。スピー
カＩ９はダイアルトーン、ビジィトーン及びリングバッ
クトーン等を監視するものである。一方、前記インタラ
ブドコントローラ１１には第２のｌ１０２０が接続して
あり、第１のｌ１０１２にはインクラブドコントローラ
２１が接続してある。また第１の１１０１２には第２の
ｌ１０２０が双方向接続してある。この第２のｌ１０２
０に双方向接続してあるのが第２のバスライン２２で、
第２のバスライン２２に双方向接続してあるのはこの他
にインクラブドコントローラ２１、第２のＣＰＵ２３、
ＲＯＭ ２４、ＲＡＭ２５、ＵＡＲＴ２６、第３のｌ１
０２７及びプログラマブルタイマ２８である。第２のＣ
ＰＵ２３はインタラブドコントローラ２１等を制御する
らのである。Ｕ Ａ ＲＴ ２６はモデムＬＳ１１３と
双方向接続してあり、第３のｌ１０２７はスイッチ２９
及びＬＥＤ３０と接続してある。尚、図において、ＩＡ
は第１のシングルデツプＣＰＵを示し、またＩＢは第２
のシングルチップＣＰＵを示すものである。Further, the programmable timer 9 arbitrarily sets the operating conditions of the timer using a control signal from the CPU 6 and a so-called user-oriented signal set by a user (not shown). Furthermore, in the intelligent modem of this embodiment, the first bus line 5 is bidirectionally connected to the I1010, the interwoven controller 11, and the first 11012. The modem LS113 and the hybrid IC 14 are bidirectionally connected to the l1010, and the modem LS113 and the hybrid IC 14 are bidirectionally connected. Bidirectionally connected to the hybrid IC 14 is a data access alignment (DAA) 15. A telephone 16 is connected to the DAA 15, and a telephone line 17 is connected to the telephone 16. Further, a speaker 19 is connected to the hybrid IC 14 via an amplifier 18. The speaker I9 monitors dial tones, busy tones, ringback tones, and the like. On the other hand, a second l1020 is connected to the interwoven controller 11, and an included controller 21 is connected to the first l1012. Further, a second l1020 is bidirectionally connected to the first l1012. This second l102
The second bus line 22 is bidirectionally connected to 0.
In addition to this, the included controller 21, the second CPU 23,
ROM 24, RAM 25, UART 26, third l1
027 and programmable timer 28. Second C
The PU 23 controls the interconnected controller 21 and the like. The U A RT 26 is bidirectionally connected to the modem LS113, and the third l1027 is connected to the switch 29.
and the LED 30. In addition, in the figure, IA
indicates the first single-deep CPU, and IB indicates the second
This shows a single-chip CPU.
次に本実施例の作用について説明する。Next, the operation of this embodiment will be explained.
第２図は本発明インテリジェントモデムを用いたコンピ
ュータデータ通信の例を示す概要図である。FIG. 2 is a schematic diagram showing an example of computer data communication using the intelligent modem of the present invention.
先ず、端末装置３ａからインテリジェントモデム１ａヘ
ダイヤルコマンド、着信コマンド及びテストコマンド等
を送出する。（１）では端末装置３ａから送出した各コ
マンドを生信号のままインテリジェントモデム１ａに供
給する。また、インテリジェントモデムｌａでＣＰＵＡ
’の指令のもと処理した結果を示すリザルトコードをイ
ンテリジェントモデム１ａから端末装置３ａへ送出する
（コマンドモード）。First, a dial command, an incoming call command, a test command, etc. are sent from the terminal device 3a to the intelligent modem 1a. In (1), each command sent from the terminal device 3a is supplied as a raw signal to the intelligent modem 1a. In addition, with intelligent modem LA, CPU
A result code indicating the result of processing under the command ' is sent from the intelligent modem 1a to the terminal device 3a (command mode).
次に、前記コマンドモード時に、インテリジェントモデ
ム１ａとインテリジェントモデム１ｂが連絡される場合
には、端末装置３ａと端末装置３ｂ間のデータ通信を行
なう（オンラインモード）。また、コマンドモード時に
ダイヤルコマンドを端末装置３ａからインテリジェント
モデム１ａに供給すると、ＣＰＵＡ’はネットワーク制
御ユニットを内蔵するハイブリットＩＣ１４ａを制御し
、電話器１６ａのダイヤリングを行なう。このとき、着
信側ではハイブリッドＩＣ１４ｂが検出する信号をＣＰ
ＵＩＡ“て監視し、これを検出する。ＣＰＵＩＡ″で検
出された前記検出信号をインタフェース２ｂを経て端末
装置３ｂへ送出する（ネットワーク制御モード）。Next, when the intelligent modem 1a and the intelligent modem 1b are contacted in the command mode, data communication is performed between the terminal device 3a and the terminal device 3b (online mode). Further, when a dial command is supplied from the terminal device 3a to the intelligent modem 1a in the command mode, the CPUA' controls the hybrid IC 14a containing a network control unit to dial the telephone 16a. At this time, on the receiving side, the signal detected by the hybrid IC 14b is
The detection signal detected by the CPUIA is sent to the terminal device 3b via the interface 2b (network control mode).
まｆこ、コマンドモード時等にモデムＬ Ｓ Ｉ １３
ａ。Modem LSI 13 during command mode, etc.
a.
１３ｂの動作を制御する制御信号及びモデムＬＳＩ＋３
ａ、 １３ｂが出力する出力信号の監視をＣＰＵＩＡ’
とＣＩ） Ｕ Ｉ Ａ″によって行なう（モデムＬＳＩ
制御モート）。Control signals that control the operation of 13b and modem LSI+3
The CPUIA' monitors the output signals output by a and 13b.
and CI) U I A'' (modem LSI
control mote).
本実施例のインテリジェントモデムによれば、２つのＣ
Ｐ ｔＪを用いることによりモデムの機能を多様化する
ことができる。また、本インテリジェントモデ１、によ
ればモデムの小型化を図ることができるので、消費電力
を低く抑えることが可能になる。According to the intelligent modem of this embodiment, two C
By using PtJ, the functions of the modem can be diversified. Furthermore, according to the present intelligent model 1, the modem can be made smaller, so power consumption can be kept low.
！−Ｉ 、発明の効采
上記のように本発明によれば、２つのＣＰＵを用いるこ
とにより、モデムの機能を多様化することができる。ま
た本発明によれば、モデムの小型化を図ることでき、消
費する消費電力を低くすることができる。! -I. Effects of the Invention As described above, according to the present invention, the functions of the modem can be diversified by using two CPUs. Further, according to the present invention, the modem can be made smaller and the power consumption can be reduced.
第１図は本発明インテリジェントモデムの一実施例を示
すブロック図、第２図は本発明インテリジェントモデム
を用いたコンピュータデータ通信の例を示す概要図、第
３図は従来のインテリジェントモデムの一例を示すブロ
ック図である。
１・・・インテリジェントモデム、２・・・インタフェ
ース、３・・・端末機器、４・・・汎用非同期式送受信
装置（Ｕ Ａ ＲＴ ）、５・・・第１のバスライン、
６・・・第１のＣＰＵ、７・・ＲＯＭ、８・・・ＲＡＭ
、９・・プログラマブルタイマ、１０・・・Ｉｌｏ、１
１・・・インタラブドコントローラ、１２・・第２の■
１０．１３・・・モデムＬＳＩ、１４・・ハイブリット
ＩＣ，１５・・・データアクセスアライメント（Ｄ Ａ
Ａ ）、１６・・・電話器、１７・・・電話回線、１
８・・・アンプ、１９・・・スピーカ、２０・・・第２
の１１０．２１・・・インクラブドコントローラ、２２
・・・第２のバスライン、２３・・・第２のＣＰＵ、２
４・・・ＲＯＭ 。
２５・・ＲＡ Ｍ、 ２６・・・汎用非同期式送受信装
置（ＵＡＲＴ）、２７・・・第３のＩｌｏ、２８・・・
プログラマブルタイマ、２９・・・スイッチ、３０・Ｌ
ＥＤ、 ｌＡ・・・第１のシングルチップＣＰＩＪ、
１Ｂ・・・第２のシングルデツプＰＵ０FIG. 1 is a block diagram showing an embodiment of the intelligent modem of the present invention, FIG. 2 is a schematic diagram showing an example of computer data communication using the intelligent modem of the present invention, and FIG. 3 is an example of a conventional intelligent modem. It is a block diagram. DESCRIPTION OF SYMBOLS 1... Intelligent modem, 2... Interface, 3... Terminal equipment, 4... General purpose asynchronous transmitting/receiving device (UART), 5... First bus line,
6...1st CPU, 7...ROM, 8...RAM
, 9...Programmable timer, 10...Ilo, 1
1... Interconnected controller, 12... Second ■
10.13...Modem LSI, 14...Hybrid IC, 15...Data access alignment (DA
A), 16...telephone, 17...telephone line, 1
8...Amplifier, 19...Speaker, 20...Second
110.21...included controller, 22
...Second bus line, 23...Second CPU, 2
4...ROM. 25... RAM, 26... General purpose asynchronous transmitting/receiving device (UART), 27... Third Ilo, 28...
Programmable timer, 29... switch, 30 L
ED, lA...first single chip CPIJ,
1B...Second single depth PU0
Claims (1)
置と処理中枢を司どるＣＰＵを第１のバスラインに接続
し、前記ＣＰＵからの制御信号によりモデム制御部を制
御するインテリジェントモデムにおいて、前記ＣＰＵは
前記第１のバスラインを経て第１のＩ／Ｏに接続してあ
る第１のＣＰＵと、前記第１のＩ／Ｏと接続してある第
２のＩ／Ｏに、第２のバスラインを介して接続してある
第２のＣＰＵとからなり、前記第１のＩ／Ｏとインター
ラプトコントローラが接続してあり、また前記第２のバ
スラインを介して第３のＩ／Ｏが接続してあることを特
徴とするインテリジェントモデム。In an intelligent modem, an asynchronous transmitting/receiving device that transmits and receives asynchronous data and a CPU that controls a processing center are connected to a first bus line, and a modem control unit is controlled by a control signal from the CPU, wherein the CPU is connected to the A second bus line is connected to a first CPU connected to a first I/O via a first bus line and a second I/O connected to the first I/O. The first I/O is connected to the interrupt controller, and the third I/O is connected to the first I/O via the second bus line. An intelligent modem characterized by:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61218845A JPS6374243A (en) | 1986-09-17 | 1986-09-17 | Intelligent modem |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61218845A JPS6374243A (en) | 1986-09-17 | 1986-09-17 | Intelligent modem |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6374243A true JPS6374243A (en) | 1988-04-04 |
Family
ID=16726242
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61218845A Pending JPS6374243A (en) | 1986-09-17 | 1986-09-17 | Intelligent modem |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6374243A (en) |
-
1986
- 1986-09-17 JP JP61218845A patent/JPS6374243A/en active Pending
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